Vos missions en quelques mots Missions : La mission de l'ingéneur recruté s'insère dans un projet ambitieux qui vise à étudier les méthodes de conception et la mise en œuvre d'un accélérateur pour l’IA sécurisée sur des systèmes embarqués. Cr projet devrait aboutir à la proposition une nouvelle approche de conception efficace dans laquelle un accélérateur d'apprentissage automatique grand et complexe est construit de manière sûre avec des contre-mesures efficaces en se composant de blocs sécurisés simples et flexibles. Dans ce cadre, la mission particulière de l'ingénieur recruté sera de réaliser l'implémentation hardware sur FPGA AMD d'un accélérateur d'IA pour RISC-V du type Google CORAL NPU. Activités : - Implémentation sur FPGA d'un coeur RISC-V - Implémentation sur FPGA de l'extension pour l'accélération de l'IA - Tests avancés Contexte de travail : Le travail sera réalisé au sein du laboratoire Hubert Curien (UMR CNRS 5516 – Université Jean Monnet), situé à Saint-Etienne. Ce laboratoire qui compte plus de 250 personnes, mènes des recherche en optique, photonique, IA, image et sécurité matérielle. L'ingénieur recruté intégrera l’équipe Systèmes Embarqués Sécurisés et Architectures Matérielles (SESAM). Cette équipe est une des équipes leader en sécurité matérielle au niveau national et international. Ses principales activités scientifiques sont développées en trois grands axes qui associent des compétences en microélectronique et électronique, en systèmes embarqués, en mathématique appliquée et en cryptographie. Profil recherché Competences : - Maitrise des flots de conception FPGA et des langages de description matérielle VHDL et SystemVerilog - Connaissance des processeurs RISC-V - Une première expérience dans l’implémentation d'accélérateur pour l'IA Contraintes et risques : Voir réglementent intérieur du Laboratoire Hubert Curien Niveau d'études minimum requis Niveau Niveau 6 Licence/diplômes équivalents Spécialisation Spécialités pluriscientifiques Langues Français Seuil
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