La Direction des Applications Militaires (DAM) du CEA, au coeur des enjeux de la dissuasion nucléaire Française, cherche ses futurs talents. Organisme inclusif, le CEA est handi-accueillant : nos emplois sont ouverts à toutes et tous.
Associer les forces et les compétences de chacun pour atteindre nos objectifs est l'une de nos valeurs partagées par nos 4 600 salariés, répartis sur 5 centres.
Les 1 000 salariés du centre du Cesta, en Nouvelle-Aquitaine, participent au développement des armes de la force de dissuasion française.
Le centre assure le rôle d'architecte industriel des têtes nucléaires mises à la disposition des Armées françaises depuis leur conception jusqu'à leur retrait du service.
Pour garantir les performances opérationnelles des systèmes d'armes, le Cesta s'inscrit dans une démarche de simulation de haut niveau et s'appuie sur un parc de moyens d'essais exceptionnels. Parmi ceux-ci, il développe et exploite le plus grand laser d'Europe : le Laser MégaJoule (LMJ).
Venez vous investir au service de la Défense et de la Sécurité de notre pays, relever des défis scientifiques et techniques avec des moyens technologiques d'exception ! Vous contribuerez à l'excellence de la recherche et à la compétitivité de l'industrie française en construisant votre avenir dans un environnement varié et respectueux. Vous intégrerez le pôle en charge de la simulation Multi-Physiques du CESTA. Il a pour mission de développer les chaines de simulation pour simuler les phénomènes de furtivité et de rentrée atmosphérique.
Dans ce cadre, les codes de simulation nécessitent d'être optimisés. L'ingénieur chercheur en calcul haute performance et accélérateurs contribuera à assurer leur portabilité sur les nouveaux supercalculateurs et optimiser leurs performances pour assurer des temps de restitution satisfaisants.
Ses principales missions seront les suivantes :
- Porter les codes sur les architectures accélérées
o Assurer la portabilité des codes de calculs sur les différentes architectures de supercalculateurs, notamment avec des accélérateurs GPU.
o Collaborer avec les équipes de développements des codes pour intégrer les meilleures pratiques en matière de portabilité.
- Optimiser les performances des codes
o Optimiser les performances des codes de calculs parallèles sur les architectures GPU en proposant des solutions de vectorisations, de parallélisations ou encore de gestion de la mémoire.
o Intégrer ou coupler des outils de profilage et de débogage aux codes de calcul pour analyser et aider à améliorer les performances
o Participer à la mise en place de piles logicielles ou prototypes pour évaluer les performances des nouvelles architectures des calculateurs.
- Formation et activité scientifique
o Former les développeurs des codes aux bonnes pratiques HPC (utilisation des ressources, outils de monitoring, etc.).
o Mener une activité scientifique
- de veille sur les architectures HPC (ex : exascale, accélérateurs GPU, FPGA) et les technologies associées (ex : MPI, OpenMP, CUDA, SYCL, etc.),
- et de publication et d'encadrement.
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