Responsabilités Principales
* - Définir, documenter, développer et exécuter des tests de vérification RTL pour des IP paramétrées, en utilisant Python et C++.
* - Maintenir et améliorer le flux de vérification, augmenter l’automatisation et améliorer les métriques.
* - Implémenter des composants de vérification comme des BBM ou des moniteurs utilisés dans les bancs d’essai.
Qualifications Requises
* - Plus de 7 ans d’expérience en ingénierie de vérification.
* - Maîtrise des langages de conception et de vérification RTL (VHDL, Verilog, SystemC, C++, Python, SystemVerilog).
* - Expérience solide avec les méthodes de vérification et les infrastructures (VIP, UVM, bancs d’essai, outils EDA).
* - Bonnes compétences en scripts shell.
* - Familiarité avec les protocoles de communication matériels (AMBA, OCP, etc.).
* - Excellentes compétences en communication écrite et verbale en Français et en Anglais.
* - Capacité à travailler efficacement en équipe.
* - Expérience en méthodologie de vérification formelle des preuves (un atout).
* - Connaissance de la technologie d’interconnexion (un atout).
Diplôme
Diplôme d’Ingénieur, Master en Informatique ou équivalent préféré.
À propos de l'Opportunité
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En tant qu’Ingénieur Vérification Senior, vous ferez partie d'une équipe dynamique dédiée à l'assurance qualité des systèmes sur puce (SoC). Vous utiliserez un langage haute performance combinant RTL et logiciel pour fournir des solutions configurables, testables et de qualité.
À Propos
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