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Stage vérification asic pcie – systemverilog/uvm

Versailles
CDI
Stage
Eviden
Publiée le 14 décembre
Description de l'offre

Une entreprise leader en transformation numérique basée aux Clayes-sous-bois recherche un stagiaire en vérification de circuits intégrés pour rejoindre son équipe. Ce stage de 6 mois commence en mars 2026 et nécessite une spécialisation en micro-électronique. Le candidat doit être autonome et curieux, avec de bonnes compétences en programmation, System Verilog et UVM. L'ambiance de travail est stimulante, avec des avantages tels qu'une salle de sport, un restaurant d'entreprise et la possibilité de télétravail à 60%. #J-18808-Ljbffr

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