Job Description Airbus Defence & Space recherche un d’Ingénieur design électronique VHDL FPGA pour équipements spatiaux (f/h) pour rejoindre notre entité Space Electronics basée à Elancourt (78), France. Au sein de l’équipe de design FPGA, vous serez impliqué(e) dans le développement, la justification et la validation de FPGAs et d’ASICs visant à être embarqués sur des équipements du domaine spatial de type avionique, carte processeur, traitement de signal, traitement d’images, mémoire de masse, télécommunication, cryptographie, etc Vos challenges : Développer des FPGA et des ASIC spatiaux, incluant la participation aux propositions techniques, aux spécifications, aux trade-off d’architecture Coder puis simuler le code VHDL, en faire le P&R, l’intégration sur carte, le valider fonctionnellement et caractériser les performances, Prendre en compte dans le développement toutes les spécificités du domaine spatial liées aux radiations, à la thermique et aux contraintes d’assemblages, Rédiger les documents projet requis par les clients, Rendre compte des coûts et planning pour vos activités Des déplacements professionnels occasionnels sont à prévoir en France et en Europe et, de ce fait, vous devez être disposé à vous déplacer en conséquence. Votre profil : Titulaire d'un diplôme d’ingénieur ou équivalent dans le domaine de l’ électronique, vous justifiez d’une expérience de 5 ans minimum dans un poste de designer VHDL Vous disposez D’une très bonne connaissance du VHDL, de la simulation, de la synthèse, du placement routage de FPGA, D’une connaissance du software bas niveau en C (pour ARM) et des langages de script, De compétences linguistiques : niveau négociation en Français et avancé en Anglais. D’une connaissance de l’électronique au sens large Vous avez la capacité de suivre des règles de design strictes, Ce poste nécessite une habilitation de sécurité ou nécessite d'être éligible à une habilitation par les autorités reconnues. Le candidat doit posséder la nationalité française conformément à l’IGI 1300 du 9 Août 2021 (§1.2.2.1).
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